Languages, Design Methods, and Tools for Electronic System Design : Selected Contributions from FDL 2018 (Lecture Notes in Electrical Engineering) / Kazmierski, Tom J. (EDT)/ Steinhorst, Sebastian (EDT)/ Große, Daniel (EDT)

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Languages, Design Methods, and Tools for Electronic System Design : Selected Contributions from FDL 2018 (Lecture Notes in Electrical Engineering)

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Languages, Design Methods, and Tools for Electronic System Design : Selected Contributions from FDL 2018 (Lecture Notes in Electrical Engineering)

Kazmierski, Tom J. (EDT)/ Steinhorst, Sebastian (EDT)/ Große, Daniel (EDT)

ウェブストア価格 ¥11,380（本体¥10,346）
Springer Nature Switzerland AG（2021/01発売）
外貨定価 US$ 54.99
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製本 Paperback:紙装版/ペーパーバック版／ページ数 192 p.
商品コード 9783030315870

Full Description

This book brings together a selection of the best papers from the twenty-first edition of the Forum on specification and Design Languages Conference (FDL), which took place on September 10-12, 2018, in Munich, Germany. FDL is a well-established international forum devoted to dissemination of research results, practical experiences and new ideas in the application of specification, design and verification languages to the design, modeling and verification of integrated circuits, complex hardware/software embedded systems, and mixed-technology systems.

Covers Assertion Based Design, Verification & Debug;
Includes language-based modeling and design techniques for embedded systems;
Covers design, modeling and verification of mixed physical domain and mixed signal systems that include significant analog parts in electrical and non-electrical domains;
Includes formal and semi-formal system level design methods for complex embeddedsystems based on the Unified Modelling Language (UML) and Model Driven Engineering (MDE).

Introduction.- Automatic Generation of Cycle-Accurate Simulink Blocks from HDL IPs.- Towards Early Validation of Firmware-Based Power Management Using Virtual Prototypes: A Constrained Random Approach.- Symbolic Simulation of Dataflow Synchronous Programs with Timers.- Language and Hardware Acceleration Backend for Graph Processing.- Runtime Task Mapping for Lifetime Budgeting in Many-Core Systems.- Fault Analysis in Analog Circuits through Language Manipulation and Abstraction.- Towards Consistency Checking Between HDL and UPF Descriptions.