VHDL Modeling for Digital Design Synthesis

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VHDL Modeling for Digital Design Synthesis

Yu-Chin Hsu/ Tsai, Kevin F./ Liu, Jessie T.

ウェブストア価格 ¥46,151（本体¥41,956）
Springer-Verlag New York Inc.（2012/10発売）
外貨定価 US$ 219.99
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製本 Paperback:紙装版/ペーパーバック版／ページ数 356 p.
言語 ENG
商品コード 9781461359937
DDC分類 621

Full Description

The purpose of this book is to introduce VHSIC Hardware Description Lan guage (VHDL) and its use for synthesis. VHDL was originally introduced as a hardware description language that per mitted the simulation of digital designs. This book tries to cover the synthesis aspect of VHDL, while keeping the simulation-specifics to a minimum.