Designing 2D and 3D Network-on-Chip Architectures

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Designing 2D and 3D Network-on-Chip Architectures

Tatas, Konstantinos/ Siozios, Kostas/ Soudris, Dimitrios

ウェブストア価格 ¥26,017（本体¥23,652）
Springer-Verlag New York Inc.（2016/08発売）
外貨定価 US$ 119.99
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製本 Paperback:紙装版/ペーパーバック版／ページ数 265 p.
言語 ENG
商品コード 9781493945504
DDC分類 621

Full Description

This book covers key concepts in the design of 2D and 3D Network-on-Chip interconnect. It highlights design challenges and discusses fundamentals of NoC technology, including architectures, algorithms and tools. Coverage focuses on topology exploration for both 2D and 3D NoCs, routing algorithms, NoC router design, NoC-based system integration, verification and testing, and NoC reliability. Case studies are used to illuminate new design methodologies.

Part I: Network-on-Chip Design Methodology.- Network-on-Chip Technology: A Paradigm Shift.- NoC Modeling and Topology Exploration.- Communication Architecture.- Power and Thermal Effects and Management.- NoC-based System Integration.- NoC Verification and Testing.- The Spidergon STNoC.- Middleware Memory Management in NoC.- On Designing 3-D Platforms.- The SYSMANTIC NoC Design and Prototyping Framework.- Part II: Suggested Projects.- Projects on Network-on Chip.