Verification Techniques for System-Level Design (Systems on Silicon)

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Verification Techniques for System-Level Design (Systems on Silicon)

Fujita, Masahiro/ Ghosh, Indradeep/ Prasad, Mukul

ウェブストア価格 ¥22,325（本体¥20,296）
Morgan Kaufmann Publishers In（2007/12発売）
外貨定価 US$ 101.00
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製本 Hardcover:ハードカバー版／ページ数 256 p.／サイズ 140 illus.
言語 ENG
商品コード 9780123706164
DDC分類 621.3815

基本説明

Explains how to verify SoC (Systems on Chip) logic designs using "formal" and "semiformal" verification techniques.

Full Description

This book will explain how to verify SoC (Systems on Chip) logic designs using "formal” and "semiformal” verification techniques. The critical issue to be addressed is whether the functionality of the design is the one that the designers intended. Simulation has been used for checking the correctness of SoC designs (as in "functional” verification), but many subtle design errors cannot be caught by simulation. Recently, formal verification, giving mathematical proof of the correctness of designs, has been gaining popularity.For higher design productivity, it is essential to debug designs as early as possible, which this book facilitates. This book covers all aspects of high-level formal and semiformal verification techniques for system level designs.