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SVA: the Power of Assertions in SystemVerilog （2ND）
  • 洋書

SVA: the Power of Assertions in SystemVerilog （2ND）  Paperback

Cerny, Eduard/ Dudani, Surrendra/ Havlicek, John

  • ウェブストア価格 ¥27,087（本体¥24,625）
  • Springer International Publishing AG（2016/08発売）
  • ポイント 246pt
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Hierarchical Annotated Action Diagrams : An Interface-Oriented Specification and Verification Method
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Hierarchical Annotated Action Diagrams : An Interface-Oriented Specification and Verification Method  Paperback,  言語：ENG

Cerny, Eduard/ Berkane, Bachir/ Girodias, Pierre

  • ウェブストア価格 ¥22,919（本体¥20,836）
  • Springer-Verlag New York Inc.（2012/10発売）
  • ポイント 208pt
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Verification Methodology Manual for SystemVerilog （2006）
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Verification Methodology Manual for SystemVerilog （2006）  Paperback,  言語：ENG

Bergeron, Janick/ Cerny, Eduard/ Hunter, Alan

  • ウェブストア価格 ¥25,003（本体¥22,730）
  • Springer-Verlag New York Inc.（2014/12発売）
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Hardware Description Languages and their Applications : Specification, modelling, verification and synthesis of microelectronic systems (Ifip Advances in Information and Communication Technology)
  • 洋書

Hardware Description Languages and their Applications : Specification, modelling, verification and synthesis of microelectronic systems (Ifip Advances in Information and Communication Technology)  Paperback,  言語：ENG

Delgado Kloos, Carlos (EDT)/ Cerny, Eduard (EDT)

  • ウェブストア価格 ¥35,422（本体¥32,202）
  • Springer-Verlag New York Inc.（2013/01発売）
  • ポイント 322pt
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