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Design of CMOS Low Power Folding and Interpolating ADC : Optimization of Area and Power for Medium Resolution Applications （Aufl. 2012. 196 S. 220 mm）
  • 洋書

Design of CMOS Low Power Folding and Interpolating ADC : Optimization of Area and Power for Medium Resolution Applications （Aufl. 2012. 196 S. 220 mm）  Paperback

Oza, Shruti/ Devashrayee, Niranjan

  • ウェブストア価格 ¥16,822（本体¥15,293）
  • LAP LAMBERT ACADEMIC PUBLISHING（2012発売）
  • ポイント 152pt
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High Speed Low Offset Power Efficient Dynamic CMOS Comparator （2019. 240 S. 220 mm）
  • 洋書

High Speed Low Offset Power Efficient Dynamic CMOS Comparator （2019. 240 S. 220 mm）  Paperback

Gandhi, Priyesh/ Devashrayee, Niranjan

  • ウェブストア価格 ¥15,313（本体¥13,921）
  • LAP LAMBERT ACADEMIC PUBLISHING（2019発売）
  • ポイント 139pt
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CMOS second generation current conveyors : Modeling and analysis of novel topologies （Aufl. 2012. 136 S. 220 mm）
  • 洋書

CMOS second generation current conveyors : Modeling and analysis of novel topologies （Aufl. 2012. 136 S. 220 mm）  Paperback

Naik, Amisha Parimal/ Devashrayee, Niranjan

  • ウェブストア価格 ¥16,822（本体¥15,293）
  • LAP LAMBERT ACADEMIC PUBLISHING（2012発売）
  • ポイント 152pt
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